（5） 电容之间不要共用过孔；

（6） 去耦电容引线不能太长。

5、降低噪声和电磁干扰原则

（1） 尽量采用45°折线而不是90°折线（尽量减少高频信号对外的发射与耦合）；

（2）  用串联电阻的方法来降低电路信号边沿的跳变速率；

（3） 石英晶振外壳要接地；

（4） 闲置不用的们电路不要悬空；

（5） 时钟垂直于IO线时干扰小；

（6） 尽量让时钟周围电动势趋于零；

（7） IO驱动电路尽量靠近pcb的边缘；

（8） 任何信号不要形成回路；

（9） 对高频板，电容的分布电感不能忽略，电感的分布电容也不能忽略；

（10） 通常功率线、交流线尽量在和信号线不同的板子上。

6、其他设计原则

（1）CMOS的未使用引脚要通过电阻接地或电源；

（2）用RC电路来吸收继电器等原件的放电电流；

（3）总线上加10k左右上拉电阻有助于抗干扰；

（4）采用全译码有更好的抗干扰性；

（5）元器件不用引脚通过10k电阻接电源；

（6）总线尽量短，尽量保持一样长度；

（7）两层之间的布线尽量垂直；

（8）发热元器件避开敏感元件；

（9）正面横向走线，反面纵向走线，只要空间允许，走线越粗越好（仅限地线和电源线）；

（10）要有良好的地层线，应当尽量从正面走线，反面用作地层线；

（11）保持足够的距离，如滤波器的输入输出、光耦的输入输出、交流电源线和弱信号线等；

（12）长线加低通滤波器。走线尽量短截，不得已走的长线应当在合理的位置插入C、RC、或LC低通滤波器；